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1、[主观题]【简答题】简述硬件描述语言HDL(VHDL/VerilogHD软件)开发PLD/FPGA的完整流程。
2、[主观题]【程序分析题】分析下面的Verilog HDL程序,回答问题。
module test1 (inI, in2, in3, in4, sel,_____);
input [1: 0] in1, in2, in3. in4
input [1: 0] sel;
output [1: 0] data_ out
____[1: 0] data_ out;
always @(in1 or in2 or in3 or in4 or sel)
case(sel)
2'b00: data_out <=in1
2'b01: data_ out < in2
2'1b10: data_ out < in3
2'b11: data_ out <= in4
default: data_ out < in1;
______
endmodule
(1)完成程序填空
(2)分析该模块的功能,根据输入信号得到相应的输出信号,完成题表。
3、[主观题]【简答题】为什么使用IP CORE成为日前现代数字系统设计的发展趋势?
4、[主观题]【简答题】用开发软件如MAX+PLUSⅡ进行EDA设计的基本过程及与传统电子设计的区别?
5、[主观题]【简答题】FPGA 和CPLD的中文名称是什么?它们分别是基于什么结构的可编程逻辑器件?这两类器件中,哪类器件的布线延迟可以预测?
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