中国地质大学网教02318计算机组成原理试题

• A.主存容量不足

• B.主存与辅存速度不匹配

• C.辅存与CPU速度不匹配

• D.主存与CPU速度不匹配

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• A.[0,1-2-32]

• B.[0,1-2-31]

• C.[0,1-2-30]

• D.[0,1]

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• A.0-64K

• B.0-32K

• C.0-64KB

• D.0-32K

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• A.计算机,操作系统,计算机

• B.计算,并行,算法

• C.硬件设备,多道程序,硬软资源

• D.硬件设备,晶体管,计算机

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• A.64,16

• B.16,64

• C.64,8

• D.16,16

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• A.[0,264-1]

• B.[0,263-1]

• C.[0,262-1]

• D.[0,263]

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• A.重写,内

• B.只读,外

• C.一次,外

• D.多次,内

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• A.控制器

• B.控制器.运算器.cache

• C.运算器和主存

• D.控制器.ALU和主存

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• A.读写存储器

• B.只读存储器

• C.闪速存储器

• D.光擦除可编程只读存储器

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• A.Futurebus+总线是一个高性能的同步总线标准

• B.基本上是一个异步数据定时协议

• C.它是一个与结构.处理器.技术有关的开发标准

• D.数据线的规模在32位.64位.128位.256位中动态可变

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• A.HOST总线不仅连接主存,还可以连接多个CPU

• B.PCI总线体系中有三种桥,它们都是PCI设备

• C.从桥连接实现的PCI总线结构不允许许多条总线并行工作

• D.桥的作用可使所有的存取都按CPU的需要出现在总线上

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• A.如WAIT线为高电平,则在T2周期后不进入T3周期,而插入一个TW周期

• B.TW周期结束后,不管WAIT线状态如何,一定转入了T3周期

• C.TW周期结束后,只要WAIT线为低,则继续插入一个TW周期,直到WAIT线变高,才转入T3周期

• D.有了WAIT线,就可使CPU与任何速度的存贮器相连接,保证CPU与存贮器连接时的时序配合

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