四川省2020年8月自考06169电子电路EDA技术历年真题及答案

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注：不同省份、不同专业的自考历年真题及答案，只要课程代码和课程名称相同，都可参考使用。

四川省2020年8月自考06169电子电路EDA技术历年真题及答案

1、电子设计自动化技术的发展大致分为CAD阶段、CAE阶段和

A.HDL阶段

B.EDA阶段

C.CPLD阶段

D.FPGA阶段

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2、在ISE Foundation 的集成工具中，可以用于综合的是

A.ISE simulator

B.XST

C.FPGA Editor

D. iMPACT

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3、设a=2’bll，b=3’b010，c=4’b1110，则在 Verilog HDL的表述中X={a, b,c}的值为

A.7’b1010110

B.8’b10101110

C.9’b110101110

D.9’b111101110

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4、IP核在EDA技术的应用和开发中具有十分重要的地位。此处的IP指的是

A.知识产权

B.互联网协议

C.网络地址

D.连接目的地址

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5、根据IP核使用的方式不同，[P核设计者可以按三种形式设计供集成选择的IP核:可再用、可重定目标以及

A.可嵌入

B.可移植

C.可通用

D.可配置

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6、若某一大规模的数字系统逻辑复杂，输入变量多，但对触发器的需求量相对较少，则该系统适合选择以下哪种可编程逻辑器件为实现平台?

A.PAL

B. GAL

C.FPGA

D. CPLD

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7、关于将编程信息下载到FPGA或CPLD中，下面说法中正确的是

A.基于E2PROM或Flash技术的CPLD的在系统下载称为配置

B.基于SRAM查找表结构的FPGA的在系统下载称为编程

C.可编程逻辑器件的配置方式分为主动配置和从动配置两类

D.在从动配置方式下，是由可编程器件引导配置过程

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8、综合是EDA设计流程的关键步骤。下面对综合的描述错误的是

A.综合就是将用HDL语言描述的寄存器传输级电路育转化成门级网表的过程

B.综合是纯软件的转换过程，与器件硬件结构无关

C.综合的目的是将多个模块化设计文件合并为一个网表文件，并使层次设计平面化

D.为实现系统的速度、面积、性能的要求，需要对综合加以约束，称为综合约束

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9、关于ISEFoundation 的应用，下面说法错误的是

A.为得到实际可用的系统设计，应该在FPGA布局布线前，根据相关的硬件电路板的要求进行FPGA芯片的引脚锁定

B.在应用ISE Foundation进行设计的过程中，只能使用其内的1具XST进行综合

C.ISE Foundation支持采用原理图的方式进行数字系统的设计与输入

D.在应用ISE Foundation环境开始设计之前，需要先为该设计任务建立一个工程项目

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10、关于系统仿真，下面描述正确的是

A.通过系统仿真，可以得知所设计系统在功能、延时等方面是否满足设计要求，并为系统的修改、优化提供依据

B.时序仿真是对综合后的网表进行的仿真，只验证设计块的基本逻辑功能

C.功能仿真需要利用FPGA芯片布局布线后的信息

D.Modelsim不支持YIDL和Verilog HDL 的混合仿真

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11、嵌入式系统的构架包括处理器、输入/输出(I/0)接口、软件和

A.存储器

B.嵌入式微处理器

C.嵌入式微控制器

D.嵌入式数字信号处理器

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12、FPGA中的依入式处理器一般情况下可以使用状态机模式、单片机模式和

A.定制嵌入模式

B.总线模式

C.寄存器模式

D.编译模式

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13、下列选项中，不是Xilinx公司的SOPC嵌入式解决方案中提供的嵌入式内核的是

A.PicoBlaze

B.MicroBlaze

C. PowerPC

D. LogiBlox

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14、关于JTAG 边界扫描测试，下面说法中错误的是

A.JTAG规范可以用于芯片的测试与配置

B.JTAG按口由4个必需的信号，以及1个可选信构成

C.JTAG在芯片I/0端上增加移位寄存器，并将这些寄存器连接起来，配合时钟复位、测试方式选择以及扫描输入和输出端口，形成边界扫描通道

D.JTAG边界扫描测试需要物理探针配合捕捉数据

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15、Sysplifypro是Synplicity公司提供的专门针对FPGA和CPLD实现的

A.设计输入工具

B.逻辑仿真工具

C.逻辑综合工具

D.在线逻辑分析工具

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