A.PAL
B.GAL
C.CPLD
D.FPGA
A.0C门
B.IL门
C.ECL门
D.TTL门
A.1:3
B.1:4
C.1:5
D.1:6
A.4
B.5
C.6
D.7
A.高速COMS
B.低功耗肖特基
C.低速肖特基
D.低密度高速
A.2个OC结构与非门线与得到与或非门。
B.与门不能做成集电集开路输出结构
C.或门不能做成 集电集开路输出结构
D.或非门不能做成集电集开路输出结构
A.一100mA
B.+ 5mA
C.一1mA
D.一500mA
A.ABC=A+B+C
B.(A+B)(A+C) =A+BC
C.A( A+B)=A+ B
D.AB+ A C+BC=AB+ AC
A.A+AB+B=A +B
B.AB+AB=A+ B
C.c,A( AB)=A+ B
D.AA+B+C=B C
A.D触发器具有两个有效状态,当Q=0时触发器处于0态
B.移位寄存器除具有数据寄存功能外还可构成计数器
C.主从JK触发器的主触发器具有一次翻转性
D.边沿触发器具有前沿触发和后沿触发两种方式,能有效克服同步触发器的空翻现象
A.(A3)16
B.(10100011) 2
C.000100011) 8421BCD
D.(203) 8
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